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Titlebook: CAD-Entwurfskontrolle in der Mikroelektronik; Mit einer Einführung Wolfgang Nebel Textbook 1985 Springer Fachmedien Wiesbaden 1985 Algorith

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樓主: audiogram
21#
發(fā)表于 2025-3-25 05:10:50 | 只看該作者
RT-Extraktion,e wird die Schaltung zunehmend verfeinert und eine hierarchische Struktur der Schaltung entwickelt, deren Verhalten simuliert werden kann. Diese Hierarchie kann mit den sp?ter entstehenden Logik-, Schaltkreis- und Layout-Hierarchien übereinstimmen.
22#
發(fā)表于 2025-3-25 09:34:36 | 只看該作者
23#
發(fā)表于 2025-3-25 15:44:33 | 只看該作者
upassen, sind z. Zt. internationale Standardisierungsbemühungen zu beobachten. Insbesondere setzt sich die Hardware-Beschreibungssprache VHDL /10/ und das Austauschformat EDIF /11/ als IEEE-Standard durch.
24#
發(fā)表于 2025-3-25 17:10:02 | 只看該作者
25#
發(fā)表于 2025-3-25 21:15:35 | 只看該作者
26#
發(fā)表于 2025-3-26 02:10:38 | 只看該作者
, da? für den Vergleich auf allen drei Ebenen das gleiche Verfahren angewendet werden kann, da? jedoch jeweils andere Typen von Elementen eingeführt werden müssen. Eine solche Vernetzung der Elemente l??t sich als Graph darstellen (Bild 7.1).
27#
發(fā)表于 2025-3-26 06:06:13 | 只看該作者
28#
發(fā)表于 2025-3-26 09:49:51 | 只看該作者
29#
發(fā)表于 2025-3-26 16:23:11 | 只看該作者
Topographische Layoutkontrolle,iligen Mindestdimensionen der verschiedenen Strukturen für seinen Proze? und erstellt hieraus einen Design-Rule-Satz (Bild 2.22). In letzter Zeit setzen sich in verst?rktem Ma?e gerasterte Design-Rules durch /9/. Bei diesen Design-Rules werden alle Dimensionen als Vielfache des Toleranzma?es Lambda einer Proze?linie angegeben.
30#
發(fā)表于 2025-3-26 17:41:24 | 只看該作者
Logikextraktion,ung der Transistorschaltung l??t sich zum einen die Anzahl der Knoten der Schaltung verringern, und zum anderen sind die zu verwendenden Modelle der Schaltungskomponenten sehr einfach. Diese beiden Vereinfachungen gestatten es, da? mit einem Logiksimulator auch gro?e Schaltungen simuliert werden k?nnen /2/.
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